Diseño de recuperador de datos y reloj adaptivo a jitter /
Descripción del proceso de elaboración de un sistema en chip de señal mixta, desde el diseño lógico hasta las síntesis lógica y física. Se centra en el desarrollo del módulo recuperador de reloj y datos (CDR) adaptivo al jitter operando a 800MHz.
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| Autor principal: | |
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| Formato: | Tesis Libro |
| Idioma: | Español |
| Publicado: |
Guadalajara, México :
edición de autor,
2018
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| Temas: | |
| Acceso en línea: | Ver documento en línea |
| Etiquetas: |
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Internet
Ver documento en línea| Código Dewey: |
EDS. 16
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| Ejemplar 412448-1 |
Disponible
Préstamo en línea
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Colección:
Tesis del ITESO en línea
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Notas:
Consultar en línea
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