Optimization of Electrical Validation and Debug Time in Reference Clocks /
Contiene: 1) Introducción; 2) El estado del arte; 3) Marco teórico y casos de depuración histórica; 4) Arquitectura del buffer del reloj; 5) Casos de estudio; 6) Conclusiones.
Guardado en:
| Autor principal: | |
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| Formato: | Tesis Libro |
| Idioma: | Inglés |
| Publicado: |
Guadalajara, México :
edición de autor,
2023
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| Temas: | |
| Acceso en línea: | Ver documento en línea |
| Etiquetas: |
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Internet
Ver documento en línea| Código Dewey: |
MLD. 106
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| Ejemplar 587495-1 |
Disponible
Préstamo en línea
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Colección:
Tesis del ITESO en línea
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Notas:
Consultar en línea
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