System-on-Chip Test Architectures : Nanometer Design for Testability /

Contenido: 1) Introducción; 2) Prueba digital de arquitectura; 3) Diseño falla-tolerancia; 4) Prueba de arquitectura sistema/red en un chip; 5) Prueba de arquitectura SIP; 6) Demora de prueba; 7) Prueba de baja potencia; 8) Enfrentar las fallas físicas, pequeños errores y problemas de confiabilidad;...

Whakaahuatanga katoa

Ngā taipitopito rārangi puna kōrero

Kaituhi matua:	Wang, Laung-Terng (ed.)
Ētahi atu kaituhi:	Stroud, Charles E. (edición) (edición), Touba, Nur A. (edición) (edición)
Hōputu:	Pukapuka
Reo:	Ingarihi
I whakaputaina:	Burlington, EUA : Morgan Kaufmann, 2008, c2008
Rangatū:	(The Morgan Kaufmann Series in Systems on Silicon)
Ngā marau:	Sistemas Embebidos - > Prueba y Medición - > Tema Principal VLSI - > Prueba y Medición - > Tema Principal VLSI - > Diseño y Construcción - > Tema Principal Sistemas Electrónicos Electrónica Digital Nanotecnología Ingeniería Electrónica
Ngā Tūtohu:	Tāpirihia he Tūtohu Kāore He Tūtohu, Me noho koe te mea tuatahi ki te tūtohu i tēnei pūkete!