Logic Synthesis and Verification Algorithms /

Contenido: Parte I Introducción: 1) Introducción; 2) Un paseo por la síntesis lógica con la ayuda de un ejemplo simple. -- Parte II Síntesis lógica de dos niveles: 3) Algebras booleanas; 4) Síntesis de circuitos de dos niveles; 5) Minimización heurística del circuitos de nivel dos; 6) Diagramas de d...

Popoln opis

Bibliografske podrobnosti

Glavni avtor:	Hachtel, Gary D. (autor)
Drugi avtorji:	Somenzi, Fabio (autor)
Format:	Knjiga
Jezik:	angleščina
Izdano:	Nueva York, EUA : Springer, 2006, c2006
Teme:	Diseño Lógico - > Tema Principal VLSI - > Diseño y Construcción VLSI - > Prueba y Medición - > Tema Principal Circuitos Integrados - > Prueba y Medición Circuitos Integrados - > Proceso de Datos - > Tema Principal Diseño Asistido por Computadora Electrónica Digital Algebra Booleana Electrónica - > Matemáticas Ingeniería Electrónica
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