Logic Synthesis and Verification Algorithms /
Contenido: Parte I Introducción: 1) Introducción; 2) Un paseo por la síntesis lógica con la ayuda de un ejemplo simple. -- Parte II Síntesis lógica de dos niveles: 3) Algebras booleanas; 4) Síntesis de circuitos de dos niveles; 5) Minimización heurística del circuitos de nivel dos; 6) Diagramas de d...
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| Autore principale: | |
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| Altri autori: | |
| Natura: | Libro |
| Lingua: | inglese |
| Pubblicazione: |
Nueva York, EUA :
Springer,
2006, c2006
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| Soggetti: | |
| Tags: |
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| 520 | |a Contenido: Parte I Introducción: 1) Introducción; 2) Un paseo por la síntesis lógica con la ayuda de un ejemplo simple. -- Parte II Síntesis lógica de dos niveles: 3) Algebras booleanas; 4) Síntesis de circuitos de dos niveles; 5) Minimización heurística del circuitos de nivel dos; 6) Diagramas de decisión binarios (BDDs). -- Parte III Modelos de sistemas secuenciales: 7) Modelos de sistemas secuenciales; 8) Síntesis y verificación de maquinas de estados finitos; 9) Autómatas finitos. -- Parte IV Síntesis lógica multinivel: 10) Síntesis lógica multinivel; 11) Minimización multinivel; 12) Generación de pruebas automáticas de circuitos combinados; 13) Tecnología de mapeo. | ||
| 649 | |a XX | ||
| 650 | |a Diseño Lógico - |x Tema Principal | ||
| 650 | |a VLSI - |x Diseño y Construcción | ||
| 650 | |a VLSI - |x Prueba y Medición - |x Tema Principal | ||
| 650 | |a Circuitos Integrados - |x Prueba y Medición | ||
| 650 | |a Circuitos Integrados - |x Proceso de Datos - |x Tema Principal | ||
| 650 | |a Diseño Asistido por Computadora | ||
| 650 | |a Electrónica Digital | ||
| 650 | |a Algebra Booleana | ||
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| 700 | |a Somenzi, Fabio |e (autor) | ||
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