Diseño e implementación de divisor de frecuencia e integración del SoC CDR adaptativo a jitter con LFSR para pruebas y PLL interno con tecnología BiCMOS de 130 nm /

Se presenta una herramienta de diseño por computadora para la analizar, caracterizar y optimizar múltiples versiones de estructuras analógicas para el bosquejo de circuitos integrados. Este instrumento busca reducir el tiempo de diseño de circuitos.

محفوظ في:
التفاصيل البيبلوغرافية
المؤلف الرئيسي: Núñez López, Francisco Javier (autor)
التنسيق: أطروحة كتاب
اللغة:الإسبانية
منشور في: Guadalajara, México : edición de autor, 2018
الموضوعات:
الوصول للمادة أونلاين:Ver documento en línea
الوسوم: إضافة وسم
لا توجد وسوم, كن أول من يضع وسما على هذه التسجيلة!

الانترنت

Ver documento en línea
تفاصيل المقتنيات من IT2
رقم الاستدعاء:
EDS. 18
Ejemplar 412450-1
Disponible
Préstamo en línea
المجموعة:
Tesis del ITESO en línea
ملاحظات:
Consultar en línea