Writing Testbenches : Functional Verification of HDL Models /

Contenido: ¿Qué es la verificación?; Herramientas de verificación; Plan de verificación; Modelos de alto nivel; Estímulos y respuestas; Pruebas de arquitectura (computadoras); Gestión de simulación; Guías de codificación.

Salvato in:
Dettagli Bibliografici
Autore principale: Bergeron, Janick (autor)
Natura: Libro
Lingua:inglese
Pubblicazione: Nueva York, EUA : Springer, 2003, c2003
Edizione:2a edición
Soggetti:
Tags: Aggiungi Tag
Nessun Tag, puoi essere il primo ad aggiungerne!!

MARC

LEADER 00000nam^a2200000^a^4500
001 000189258
005 20260814000000.0
009 20260815113629.22
020 |a 1-4020-7401-8 
037 |a Acervo ITESO - Biblioteca 
041 |a ING 
082 |a 621. 3815  |b BER 
100 |a Bergeron, Janick  |e (autor) 
245 1 0 |a Writing Testbenches :  |b Functional Verification of HDL Models /  |c J. Bergeron ; pról. de Harry Foster. 
250 |a 2a edición 
264 4 |a Nueva York, EUA :  |b Springer,  |c 2003, c2003 
300 |a XXX, 475 p. 
336 |a texto  |b txt  |2 rdacontenido 
337 |a sin mediación  |b n  |2 rdamedio 
338 |a volumen  |b nc  |2 rdasoporte 
520 |a Contenido: ¿Qué es la verificación?; Herramientas de verificación; Plan de verificación; Modelos de alto nivel; Estímulos y respuestas; Pruebas de arquitectura (computadoras); Gestión de simulación; Guías de codificación. 
649 |a XX 
650 |a Circuitos Integrados -  |x Prueba y Medición -  |x Tema Principal 
650 |a Electrónica Digital 
650 |a Lenguaje Máquina 
650 |a Métodos de Simulación 
650 |a Ingeniería Computacional 
650 |a Ingeniería Electrónica 
910 |a Fondo General 
920 |a Impresos - Libros 
930 |a Colección General 
905 |a 101 
901 |a 0500132224  |b IT1  |c ACC  |u 20260814 
902 |a https://opac.biblio.iteso.mx/vufind/Record/000189258