Computer Architecture : A Quantitative Approach /
Contenido: 1. Fundamentos del diseño y del análisis cuantitativo; 2. Diseño jerárquico de la memoria; 3. Paralelismo del nivel de instrucción y su explotación; 4. Paralelismo del nivel de datos en arquitecturas Vector, SIMD y GPU; 5. Paralelismo en el nivel de los hilos; 6. Computadoras de almacenam...
Sábháilte in:
| Príomhchruthaitheoir: | |
|---|---|
| Rannpháirtithe: | , |
| Formáid: | LEABHAR |
| Teanga: | Béarla |
| Foilsithe / Cruthaithe: |
Cambridge, EUA :
Morgan Kaufmann,
2019, c2019
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| Eagrán: | 6a edición |
| Ábhair: | |
| Clibeanna: |
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MARC
| LEADER | 00000nam^a2200000^a^4500 | ||
|---|---|---|---|
| 001 | 000439570 | ||
| 005 | 20250521000000.0 | ||
| 009 | 20260310123314.519 | ||
| 020 | |a 978-0-12-811905-1 | ||
| 037 | |a Acervo ITESO - Biblioteca | ||
| 041 | |a ING | ||
| 082 | |a 004. 22 |b HEN | ||
| 100 | |a Hennessy, John L. |e (autor) | ||
| 240 | 1 | 1 | |a [Arquitectura de computadores: un enfoque cuantitativo] |
| 245 | 1 | 0 | |a Computer Architecture : |b A Quantitative Approach / |c J.L. Hennessy, D.A. Patterson ; colaboración de K. Asanovic... [et al.] ; pról. de Norman P. Jouppi. |
| 250 | |a 6a edición | ||
| 264 | 4 | |a Cambridge, EUA : |b Morgan Kaufmann, |c 2019, c2019 | |
| 300 | |a XXIX, 617, [284] p. | ||
| 336 | |a texto |b txt |2 rdacontenido | ||
| 337 | |a sin mediación |b n |2 rdamedio | ||
| 338 | |a volumen |b nc |2 rdasoporte | ||
| 520 | |a Contenido: 1. Fundamentos del diseño y del análisis cuantitativo; 2. Diseño jerárquico de la memoria; 3. Paralelismo del nivel de instrucción y su explotación; 4. Paralelismo del nivel de datos en arquitecturas Vector, SIMD y GPU; 5. Paralelismo en el nivel de los hilos; 6. Computadoras de almacenamiento a escala para explotar el nivel de requerimientos y el paralelismo del nivel de datos; 7. Dominio específico de arquitecturas. Apéndices: A. Principios del conjunto de instrucciones; B. Revisión de la jerarquía de la memoria; C. Segmentación: conceptos básicos e intermedios; D. Sistemas de almacenamiento; E. Sistemas embebidos; F. Redes interconectadas; G. Procesadores de vectores con mayor profundidad; H. Hardware y software para VLIW y EPIC; I. Multiprocesadores de gran escala y aplicaciones científicas; J. Aritmética computacional; K. Encuesta de la arquitectura del conjunto de instrucciones; L. Traducción de direcciones de conceptos avanzados; M. Perspectivas históricas y referencias. | ||
| 521 | |a 2022 BO Especialidad en Sistemas Embebidos | ||
| 649 | |a XX | ||
| 650 | |a Microprocesadores | ||
| 650 | |a Caché (Ingeniería Computacional) | ||
| 650 | |a Memorias (Ingeniería Computacional) | ||
| 650 | |a Bus de Datos | ||
| 650 | |a Almacenamiento de Información (Cómputo) | ||
| 650 | |a Componentes (Hardware) | ||
| 650 | |a Arquitectura de Computadoras - |x Tema Principal | ||
| 650 | |a Computadoras | ||
| 650 | |a Ingeniería Electrónica | ||
| 650 | |a Ingeniería Computacional | ||
| 700 | |a Patterson, David A. |e (autor) | ||
| 700 | |a Asanovic, Krste |e (colaboración) | ||
| 910 | |a Fondo General | ||
| 920 | |a Impresos - Libros | ||
| 930 | |a Colección General | ||
| 905 | |a 101 | ||
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| 902 | |a https://opac.biblio.iteso.mx/vufind/Record/000439570 | ||