Anar al contingut
Biblioteca Dr. Jorge Villalobos Padilla, SJ
Dirección de Información Académica
Opiniones y sugerencias
Bossa de llibres :
0
ítems
( Complet )
Autenticació institucional
Idioma
Inglés
Deutsch
Español
Français
Italiano
日本語
Nederlands
Português
Português (Brasil)
中文(简体)
中文(繁體)
Türkçe
עברית
Gaeilge
Cymraeg
Ελληνικά
Català
Euskara
Русский
Čeština
Suomi
Svenska
polski
Dansk
slovenščina
اللغة العربية
বাংলা
Galego
Tiếng Việt
Hrvatski
हिंदी
Հայերէն
Українська
Sámegiella
Монгол
Māori
Opiniones y sugerencias
Bossa de llibres :
0
ítems
( Complet )
Autenticació institucional
Idioma
Inglés
Deutsch
Español
Français
Italiano
日本語
Nederlands
Português
Português (Brasil)
中文(简体)
中文(繁體)
Türkçe
עברית
Gaeilge
Cymraeg
Ελληνικά
Català
Euskara
Русский
Čeština
Suomi
Svenska
polski
Dansk
slovenščina
اللغة العربية
বাংলা
Galego
Tiếng Việt
Hrvatski
हिंदी
Հայերէն
Українська
Sámegiella
Монгол
Māori
Página de inicio
Portal Biblioteca
Tesauro
Reservar espacios
Revistas
Aviso de privacidad
Tots els camps
Títol
Autor
Matèria
Signatura
ISBN/ISSN
Etiqueta
Número de sistema
Trobar
Avançada
Sistema de recuperador de dato...
Citar
Enviar per correu electrònic aquest
Imprimir
Exportar registre
Exportar a RefWorks
Exportar a EndNote
Exportar a Zotero Web Library
Afegir a favorits
Enllaç permanent
Sistema de recuperador de datos y reloj utilizando sobre-muestreo a lazo abierto /
Guardat en:
Dades bibliogràfiques
Autor principal:
González Navarro, Martín
(autor)
Format:
Thesis
Llibre
Idioma:
espanyol
Matèries:
Circuitos de Tiempo -
>
Tema Principal
VERILOG (Lenguaje de Descripción del Soporte Físico)
Transmisión de Datos
Sistemas de Telecomunicación
Ingeniería Electrónica
Etiquetes:
Afegir etiqueta
Sense etiquetes, Sigues el primer a etiquetar aquest registre!
Fons
Descripció
Comentaris
Ítems similars
Visualització del personal
Sigues el primer a deixar un comentari!
Comentaris
Abans heu d’iniciar sessió
Ítems similars
Diseño físico de un circuito de conversión de datos paralelo-serie-paralelo /
per: Velarde González, Fabio Alberto
Publicat: (2007)
Metodología de cobertura para la validación de circuitos integrados /
per: Arceo Salcido, Ana Laura
Publicat: (2009)
Verification Methodology Manual for SystemVerilog /
Publicat: (2006, c2006)
Learning by Example Using Verilog : Basic Digital Design with a Basys FPGA Board /
per: Haskell, Richard E.
Publicat: (2008, c2008)
Learning by Example Using Verilog : Advanced Digital Design Using a Nexys 2 FPGA Board /
per: Haskell, Richard E.
Publicat: (2009, c2009)
© 2026 Catálogo Público de la Biblioteca V/F -- v.11.0