Accelerating Post-Silicon Debug : An Ensemble Machine Learning and Explainable AI Approach for Platform Boot Failures /
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| Autor principal: | |
|---|---|
| Format: | Thesis Llibre |
| Idioma: | anglès |
| Publicat: |
Guadalajara, México :
edición de autor,
2026
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| Matèries: | |
| Accés en línia: | Ver documento en línea |
| Etiquetes: |
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|
MARC
| LEADER | 00000nam^a2200000^a^4500 | ||
|---|---|---|---|
| 001 | 000631592 | ||
| 005 | 20260512000000.0 | ||
| 009 | 20260713152646.569 | ||
| 037 | |a Acervo ITESO - Biblioteca | ||
| 041 | |a ING | ||
| 090 | |a MLD. 135 | ||
| 100 | |a Michel Torres, David |e (autor) | ||
| 245 | 1 | 0 | |a Accelerating Post-Silicon Debug : |b An Ensemble Machine Learning and Explainable AI Approach for Platform Boot Failures / |c D.Michel Torres. |
| 264 | 1 | |a Guadalajara, México : |b edición de autor, |c 2026 | |
| 300 | |a 1 tesis electrónica en línea (5 p.) | ||
| 300 | |a 1 recurso en línea | ||
| 336 | |a datos para computadora |b cod |2 rdacontenido | ||
| 337 | |a computadora |b c |2 rdamedio | ||
| 338 | |a recurso en línea |b cr |2 rdasoporte | ||
| 502 | |a ITESO Tesis de Maestría en Diseño Electrónico | ||
| 506 | 1 | |a TOG con embargo | |
| 649 | |a XX | ||
| 650 | |a Aprendizaje Automático (Inteligencia Artificial) | ||
| 650 | |a Redes Neurales | ||
| 650 | |a Inteligencia Artificial - |x Tema Principal | ||
| 650 | |a Circuitos Integrados - |x Diseño y Construcción - |x Tema Principal | ||
| 650 | |a Microelectrónica | ||
| 650 | |a Ingeniería Electrónica | ||
| 856 | 4 | 0 | |u https://rei.iteso.mx/handle/11117/12122 |y Ver documento en línea |
| 910 | |a Fondo General | ||
| 920 | |a Electrónicos - Tesis del ITESO en Línea | ||
| 930 | |a Repositorio Institucional | ||
| 905 | |a 201 | ||
| 902 | |a https://opac.biblio.iteso.mx/vufind/Record/000631592 | ||